💻 这个是基于NIOS II的FPGA平台的一个CF卡的接口模块 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 ddr_sdram_auk_ddr_datapath.v
7.14 KB
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2
📄 button_pio.v
4.05 KB
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3
📄 ddr_sdram_bb.v
2.49 KB
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4
📄 standard.qpf
1.53 KB
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5
📄 verify_timing_for_ddr_sdram.tcl
1.16 KB
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6
📄 ddr_sdram.v
5.95 KB
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7
📄 rf_ram_a.mif
600 B
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8
📃 readme.txt
3.07 KB
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9
📃 bb_list.txt
605 B
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10
📄 epcs_controller.v
17.29 KB
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11
📄 remove_add_constraints_for_ddr_sdram_2005_04_20___20_33.tcl
64 KB
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12
📄 cf.v
6.75 KB
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13
📃 ddr_sdram_extraction_log.txt
11.87 KB
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14
📄 ddr_sdram_example_driver.v
21.99 KB
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15
📄 high_res_timer.v
6.6 KB
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16
📃 ddr_sdram_extraction_log2.txt
64 KB
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17
📄 std_2c35_setup_quartus.tcl
26.69 KB
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18
📄 uart1.v
31.68 KB
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19
📄 ddr_sdram_auk_ddr_clk_gen.v
3.89 KB
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20
📄 standard.bdf
64 KB
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21
📃 ddr_sdram_extraction_data.txt
21.42 KB
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22
📄 rf_ram_b.mif
600 B
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23
📄 standard.sof
0 B
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24
📄 std_2c35.v
64 KB
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25
📄 add_constraints_for_ddr_sdram.tcl
64 KB
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26
📄 ddr_sdram_debug_design_tb_1.v
20 KB
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27
📄 ddr_sdram_debug_design_1.v
9.1 KB
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28
📄 ddr_sdram.inc
2.03 KB
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29
📄 ssram_pll.v
8.4 KB
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30
📄 ddr_pll_cycloneii.v
11.72 KB
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31
📄 epcs_controller_boot_rom.hex
2.53 KB
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32
📄 ddr_sdram.cmp
2.54 KB
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33
📄 cpu.ocp
0 B
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34
📄 reconfig_request_pio.v
2.56 KB
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35
📄 remove_add_constraints_for_ddr_sdram.tcl
64 KB
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36
📄 standard.pin
64 KB
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37
📄 ddr_sdram_auk_ddr_sdram.v
11.56 KB
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38
📃 pin_assignment_script.txt
2.02 KB
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39
📄 auto_verify_ddr_timing.tcl
257 B
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40
📃 ddr_sdram_post_summary.txt
1.56 KB
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41
📄 ic_tag_ram.mif
1.84 KB
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42
📄 cpu_ociram_default_contents.mif
5.74 KB
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43
📃 ddr_sdram_pre_compile_ddr_timing_summary.txt
119 B
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44
📄 cpu.v
0 B
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45
📄 ddr_sdram_inst.v
2.35 KB
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46
🌐 ddr_sdram.html
5.3 KB
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47
📄 std_2c35.bsf
13.32 KB
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48
📄 sysid.v
1.16 KB
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49
📄 jtag_uart.v
20.29 KB
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50
📄 standard.qsf
64 KB
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