💻 SDRAM读写控制的实现与Modelsim仿真 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
51
📄 edntongd_tcl.rsp
62 B
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52
📄 bitgen.rsp
470 B
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53
📄 project.gfl
12.93 KB
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54
📄 jhdparse.log
0 B
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55
📄 test.xst
1.02 KB
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56
📄 test_ncdtout_tcl.rsp
19 B
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57
📄 parentassignpackagepinsapp_tcl.rsp
26 B
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58
📄 sumrpt_tcl.rsp
26 B
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59
📄 project_flowplus.gfl
1.02 KB
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60
📄 test_vhdl.prj
0 B
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61
📄 test.ncd
42.49 KB
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62
📄 test.ngc
0 B
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63
📄 test.bld
577 B
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64
📄 test.ngr
0 B
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65
📄 __projnav.log
0 B
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66
📄 test.mrp
13.94 KB
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67
📄 test.stx
0 B
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68
📄 automake.log
0 B
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69
📄 test_signalbrowser.ngo
0 B
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70
📄 test_signalbrowser.ver
6 B
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71
📄 icon_pro.ncf
392 B
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72
📄 ila_pro_0.ncf
173 B
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73
📄 icon_pro.edn
64 KB
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74
📄 icon_pro.ngo
0 B
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75
📄 ila_pro_0.ngo
0 B
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76
📄 netlist.lst
46 B
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77
📄 ila_pro_0.edn
64 KB
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78
📄 test.spl
161 B
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79
📄 micron_sdram.pdf
0 B
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80
📄 mt48lc2m32b2.v
1 KB
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81
📄 control_interface.v
8.29 KB
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82
📄 sdr_sdram.v
7.06 KB
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83
📄 params.v
935 B
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84
📄 sdr_data_path.v
2.7 KB
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85
📄 command.v
17.12 KB
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86
📄 32wave.bmp
0 B
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87
📄 sdram_test_tb.v
7.61 KB
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88
⚙️ verilog.asm
0 B
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89
📄 _primary.dat
0 B
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90
📄 _primary.vhd
502 B
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91
📄 _info
1.78 KB
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92
⚙️ verilog.asm
0 B
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93
📄 _primary.dat
0 B
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94
📄 _primary.vhd
877 B
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95
⚙️ verilog.asm
0 B
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96
📄 _primary.dat
0 B
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97
📄 _primary.vhd
1.26 KB
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98
⚙️ verilog.asm
0 B
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99
📄 _primary.dat
0 B
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100
📄 _primary.vhd
1.08 KB
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