基于USB2.0FPGA的高速数据采集系统的研究与设计.rar
随着科学技术的快速发展和数据采集系统的广泛应用，人们对数据采集系统的速度、精度、易操作性以及实时性的要求也在不断地提高。通用串行总线USB作为一种新型的微机总线接口规范，以其使用方便、易于扩展、速度快等优点而被广泛地应用于数据采集系统中。现场可编程门阵列最大的特点是结构灵活，开发周期较短，适合于实时...
高速数据采集系统技术资料
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高速数据采集系统广泛应用于军事、航天、航空、铁路、机械等诸多行业。区别于中速及低速数据采集系统，高速数据采集系统内部包含高速电路，电路系统1/3以上数字逻辑电路的时钟频率>=50MHz；对于并行采样系统，采样频率达到50MHz，并行8bit以上；对于串行采样系统，采样频率达到200MHz，广泛使用的高速数据采集系统采样频率一般在200KS/s~100MS/s，分辨率16bit~24bit。
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数据采集系统是信号与信息处理系统中不可缺少的重要组成部分，同时也是软件无线电系统中的核心模块，在现代雷达系统以及无线基站系统中的应用越来越广泛。为了能够满足目前对软件无线电接收机自适应性及灵活性的要求，并充分体现在高性能FPGA平台上设计SOC系统的思路，本文提出了由高速高精度A/D转换芯片、高性能...
基于FPGA控制的高速数据采集系统
数据采集系统是信号与信息处理系统中不可缺少的重要组成部分，同时也是软件无线电系统中的核心模块，在现代雷达系统以及无线基站系统中的应用越来越广泛。为了能够满足目前对软件无线电接收机自适应性及灵活性的要求，并充分体现在高性能FPGA平台上设计SOC系统的思路，本文提出了由高速高精度A/D转换芯片、高性能...
5 Gsps高速数据采集系统的设计与实现
以某高速实时频谱仪为应用背景，论述了5 Gsps采样率的高速数据采集系统的构成和设计要点，着重分析了采集系统的关键部分高速ADC（analog to digital，模数转换器）的设计、系统采样时钟设计、模数混合信号完整性设计、电磁兼容性设计和基于总线和接口标准（PCI Express）的数据传...
基于CPLD与单片机的高速数据采集系统
本文针对新型匝间耐压测试仪中需要高速采集数据的问题提出了一种结合CPLD 与单片机的高速数据采集系统设计方案。CPLD 产生A/D 芯片的控制时序以及SRAM 的读写控制时序，单片机输出给CPLD控制A/D 转换的启动信号，并通过CPLD 读取SRAM 中的采样数据。该系统具有较好的可移植性。...
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