最大比合并
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查看全部 500 份 →实现CDMA系统的RAKE接收,比较最大比合并、等增益合并、、选择合并接收算法的性能
实现CDMA系统的RAKE接收,比较最大比合并、等增益合并、、选择合并接收算法的性能,采用3条多径,每条多径之间延迟半个码片,信源输入采用16位WALSH码扩频
2014-07-01
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串并结合的维特比算法的FPGA实现.rar
卷积码是一种应用广泛的信道纠错码,维特比算法是卷积码近最优的译码算法。随着FPGA芯片处理能力和设计的灵活性发展,在FPGA芯片中完成维特比译码算法成为了通信系统设计的一个有效手段。 @@ 本文在分析研究维特比算法的基础上,设计并实现了了一...
2023-09-28
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