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本书读者如果配合一套可在PC586 平台上运行的Verilog HDL 仿真和综合工具，如 QuickLogic 公司的Spade 的教学软件包(Verilog HDL 版)、Mentor 公司的Modelsim 等开发环境下，只要带Verilog HDL 仿真器(如Verilog-XL)和综合器...
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VerilogHDL是一种硬件描述语言，以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。VerilogHDL和VHDL是世界上最流行的两种硬件描述语言，都是在20世纪80年代中期开发出来的。前者由GatewayDesignAutomation公司（该公司于1989年被Cadence公司收购）开发。两种HDL均为IEEE标准。[1]
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