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多个Verilog和vhdl程序例子，可以作为初学者参考实例，按照电路结构写出HDL代码...

📅 2013-08-26 👤 athjac

Verilog vhdl 程序

fpga-jpeg-verilog在fpga平台使用verilog语言进行jpeg算法实现

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📅 2013-08-28 👤 zoudejile

fpga-jpeg-verilog verilog fpga jpeg

Verilog实现的DDS正弦信号发生器和测频测相模块

Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。...

📅 2013-08-28 👤 asdfasdfd

Verilog DDS 正弦信号发生器模块

verilog HDL 编写的PWM

verilog HDL 编写的PWM，是初学CPLD者入门Z资源，epm7128stc100-10...

📅 2013-08-30 👤 aa54

verilog HDL PWM 编写

dds设计，生成多种波形，Verilog语言

dds设计，花了一个星期做的,verilog写的，可生成多种波形，频率范围可上M,性能不错。...

📅 2013-08-30 👤 wentianyou

Verilog dds 波形语言

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