一阶IIR数字滤波器时域滤波效果模拟tzl1963摘要- 供初学如何设计实际的数字滤波器参考。一,基本概念FIR Filter-有限长单位脉冲响应滤波器,传递函数:Σ−=−=10)()(NnnznhzH ; (1))(nh是一个有限长序列。IIR Filter-无限长单位脉冲响应滤波器,传递函数: ΣΣ=−=−−=NiiNiizbzazH01011)( ; (2)二,冲激响应不变法设模拟滤波器的冲激响应是h,取样周期是T,则它的取样冲击响应是。又设数字滤波器的冲击响应是。如果让 )(tA)(n)(nThAh)(nh= (3) )(nThA这就是冲激响应不变法,物理概念就是让数字滤波器的冲激响应等于对应的模拟滤波器冲激响应的抽样函数。模拟滤波器的传递函数是它的冲激函数的拉氏变换,数字滤波器的传递函数的它的冲激函数的z变换。
上传时间: 2013-11-20
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在现代通信系统中,电话语音的频带被限制在300 Hz~4 kHz的范围内,带来了语音可懂度和自然度的降低。为了在不增加额外成本的前提下提高语音的可懂度和自然度,进行了电话语音频带扩展的研究。提出了一种改进的基于码本映射的语音带宽扩展算法:在码本映射的过程中,使用加权系数来得到映射码本。客观测试结果表明,用此算法得到的宽带语音的谱失真度比用一般的码本映射降低至少2%。主观测试结果表明,用此算法得到的宽带语音具有更好的可懂度和自然度。 Abstract: In modern communication systems, the bandwidth of telephone speech is limited from 300Hz to 4 kHz, which reduces the intelligibility and naturalness of speech. Telephone speech bandwidth extension is researched to get wideband speech and to improve its intelligibility and naturalness, without increasing extra costs. This paper put forward an improved algorithm of speech bandwidth extension based on codebook mapping. In the process of codebook mapping, weighted coefficients were used to get mapping codebook. Objective tests show that spectral distortion of wideband speech obtained by this algorithm reduces at least 2%, comparing to conditional codebook mapping. Subjective tests show that the wideband speech obtained by this algorithm has better intelligibility and naturalness.
上传时间: 2014-12-29
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ADXL345的详细介绍资料 本模块使用说明书。 本压缩文件能够利用角度传感器对x,y,z三方的加速度值,角度值进行测量,并集成了1602对其进行显示。 为了便于使用,我们分别将模块单独化,如果您有使用的意向,可以单独摘出 angle.c 引入到您自己新建的工程中。 关于angle.c文件的内部函数使用说明。 首先为了便于使用和方便引用我们对内部函数进行了高度集成化,您在引入angle.c后直接在您的主程序中调用 dis_data();函数,可完成ADXL345芯片的测量数据, 测量数据说明: char as_Xjiasu[6],as_Yjiasu[6],as_Zjiasu[6]; //定义3轴静态重力加速度值的ASCII码值 unsigned char as_Xangel[4],as_Yangel[4],as_Zangel[4]; //定义3轴角度值的ASCII码值 as_Xjiasu[x]数组里边我们为了您的使用直接将 加速度值转换成了 能够直接显示到 1602上的ASCII码值,同理as_Xangel 真实数据存放说明。 float jiasu_xyz[3]; angel_xyz[3]; //存放X,Y,Z 轴的静态重力加速度,角度值 存放了 加速度和角度的真实值(未经转换成ASCII码的数据)--本数据可以用于其他用途,直接参与MCU内部运算等。
上传时间: 2013-11-17
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设计了一种新型结构的体硅工艺梳齿电容式加速度计,该设计采用2个检测质量块,分别检测水平方向和垂直方向的加速度。x,y水平方向不对称梳齿的设计,消除了z轴对水平轴向加速度的干扰,同时z轴支撑梁的设计,解决了水平轴向对z轴的干扰。
上传时间: 2013-10-13
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用MDK 生成bin 文件1用MDK 生成bin 文件Embest 徐良平在RV MDK 中,默认情况下生成*.hex 的可执行文件,但是当我们要生成*.bin 的可执行文件时怎么办呢?答案是可以使用RVCT 的fromelf.exe 工具进行转换。也就是说首先将源文件编译链接成*.axf 的文件,然后使用fromelf.exe 工具将*.axf 格式的文件转换成*.bin格式的文件。下面将具体说明这个操作步骤:1. 打开Axf_To_Bin 文件中的Axf_To_Bin.uv2 工程文件;2. 打开Options for Target ‘Axf_To_Bin’对话框,选择User 标签页;3. 构选Run User Programs After Build/Rebuild 框中的Run #1 多选框,在后边的文本框中输入C:\Keil\ARM\BIN31\fromelf.exe --bin -o ./output/Axf_To_Bin.bin ./output/Axf_To_Bin.axf 命令行;4. 重新编译文件,在./output/文件夹下生成了Axf_To_Bin.bin 文件。在上面的步骤中,有几点值得注意的是:1. C:\Keil\ARM\BIN31\表示RV MDK 的安装目录;2. fromelf.exe 命令的具体语法格式如下:命令的格式为:fromelf [options] input_file命令选项如下:--help 显示帮助信息--vsn 显示版本信息--output file 输出文件(默认的输出为文本格式)--nodebug 在生成的映象中不包含调试信息--nolinkview 在生成的映象中不包含段的信息二进制输出格式:--bin 生成Plain Binary 格式的文件--m32 生成Motorola 32 位十六进制格式的文件--i32 生成Intel 32 位十六进制格式的文件--vhx 面向字节的位十六进制格式的文件t--base addr 设置m32,i32 格式文件的基地址--text 显示文本信息文本信息的标志-v 打印详细信息-a 打印数据地址(针对带调试信息的映象)-d 打印数据段的内容-e 打印表达式表print exception tables-f 打印消除虚函数的信息-g 打印调试表print debug tables-r 打印重定位信息-s 打印字符表-t 打印字符串表-y 打印动态段的内容-z 打印代码和数据大小的信息
上传时间: 2013-12-17
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介绍这一章介绍ARMTDMI-S 处理器包含以下小节 关于ARM7TDMI-S 处理器 ARM7TDMI-S 结构 ARM7TDMI-S 模块内核和功能框图 ARM7TDMI-S 指令集汇总 Rev 3a 和Rev 4 之间的差异1.1 关于ARM7TDMI-S 处理器ARM7TDMI-S 处理器是ARM 通用32 位微处理器家族的成员之一ARM 处理器具有优异的性能但功耗却很低使用门的数量也很少ARM 结构是基于精简指令集计算机(RISC)原理而设计的指令集和相关的译码机制比复杂指令集计算机要简单得多这样的简化实现了 高的指令吞吐量 出色的实时中断响应 小的高性价比的处理器宏单元
标签: arm7tdmi
上传时间: 2014-12-30
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根据一些环境温度湿度实时监测的需要,采用首个符合Zigbee标准的CC2430射频芯片,以SHT10为温湿度传感器来设计实现温度湿度的数据采集与传输。利用TI公司的Z-Stack协议栈在IAR开发环境下,建立一个无线传感器网络。网络协调器通过RS232串口与PC通信,实现对温度湿度的无线智能监测
上传时间: 2013-11-05
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为解决现Z-Stack定位程序代码量大,结构复杂等问题,提出一种基于TinyOS的CC2430定位方案。在分析TinyOS组件架构基础上,设计实现盲节点、锚节点与汇聚节点间的无线通信以及汇聚节点与PC机的串口通信。在此基础上实现PC对各锚节点RSSI(Received Signal Strength Indicator)寄存器值的正确读取,确定实验室环境下对数-常态无线传播模型的具体参数,并采用质心算法来提高定位精度。实验显示,在由四个锚节点组成的4.8×3.6 m2矩形定位区域中,通过RSSI质心定位算法求得的盲节点坐标为(2.483 1,1.018 5),实际坐标为(2.40,1.20),误差为0.199 6 m,表明较好地实现对盲节点的定位。
上传时间: 2013-10-21
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SDH传输系统光接口 SDH光接口的分类及应用代码 应用代码的表达方式:X-Y.Z,如:V-64.2、S-64.1
上传时间: 2013-11-22
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完整性高的FPGA-PCB系统化协同设计工具 Cadence OrCAD and Allegro FPGA System Planner便可满足较复杂的设计及在设计初级产生最佳的I/O引脚规划,并可透过FSP做系统化的设计规划,同时整合logic、schematic、PCB同步规划单个或多个FPGA pin的最佳化及layout placement,借由整合式的界面以减少重复在design及PCB Layout的测试及修正的过程及沟通时间,甚至透过最佳化的pin mapping、placement后可节省更多的走线空间或叠构。 Specifying Design Intent 在FSP整合工具内可直接由零件库选取要摆放的零件,而这些零件可直接使用PCB内的包装,预先让我们同步规划FPGA设计及在PCB的placement。
标签: Allegro Planner System FPGA
上传时间: 2013-11-06
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