Xilinx+V4

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目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPG...

2013-11-20 98 Xilinx+V4

UART 4 UART参考设计，Xilinx提供VHDL代码 uart_vhdl This zip file contains the following folders:  \vhdl_source &nbsp...

2013-11-02 66 Xilinx+V4

通过 VLYNQ 把 Xilinx FPGA 作为 TI DSP 的外设.rar

2013-08-13 48 Xilinx+V4

华为公司的内部资料，关于如何写好FPGA程序的好教程，Xilinx篇

2013-08-16 164 Xilinx+V4

2016-04-20 90 Xilinx+V4

Xilinx高级试验的代码.zip 非常不错，希望对大家有用，谢谢！：）

2013-12-26 136 Xilinx+V4

这是一个基于xilinx ISE9.1的一个历程，包含两个FIFO代码，第一个FIFO读写用同一个时钟，第二个FIFO读写用不同的时钟。

2016-10-22 22 Xilinx+V4

2013-12-25 59 Xilinx+V4