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I2C总线的verilog语言实现,稍经修改即可应用于实际工程
verilog语言实现的数字钟,各种定时闹钟功能类似真实的表~利用EDA实验平台实现~~
实现累加器的verilog源码,广泛应用在通信电路设计中
213viterbi译码的verilog语言实现
ep2c5 实现 逻辑门 verilog语言,quartus 2 仿真
ep2c5 实现 定时器 verilog语言,quartus 2 仿真
用verilog实现的数字跑表,下载到FPGA开发板上验证通过。下载后从新分配引脚即可用。
verilog实现卷积码的译码,viterbi算法
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