Verilog代码
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Verilog代码 热门资料
查看全部 500 份 →Content Addressable Memory 的verilog源代码。经过modelsim仿真。
Content Addressable Memory 的verilog源代码。经过modelsim仿真。
2013-12-31
68
ARM_显示器_键盘_源代码verilog examples resource code
ARM_显示器_键盘_源代码\verilog examples resource code
2014-01-03
148
异步时钟域多位Handshake传输Verilog代码
在数字电路设计中,常用Handshake将多比特数据在不同时钟域之间传输,多比特数据传输必须考虑亚稳态和数据比特之间的同步。本模块实现了多比特数据在两个时钟域之间的稳定可靠传输,并带有传输完成信号。数据位宽可配置。
2026-03-05
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