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自己设计的串口verilog代码,已在fpga上跑过,问题无误。
FPGA开发板上写的Verilog代码 FPGA开发板上写的Verilog代码
MPEG2+MAC Verilog代码+文档(FPGA实现)
基于quartus的verilog源代码,实现计数器功能仿真。
基于verilog的实例代码
39阶FIR滤波器verilog源代码,用乘法器实现,全并行结构,适合用于在有硬件乘法器的FPGA中实现
8乘8乘法器verilog源代码 有需要的朋友下来看看
一个 关于 60秒计时器 的verilog 源代码,EDA 设计。
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