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Verilog+Code

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Verilog+Code 热门资料

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64位乘法器源码verilog,经过验证测试

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2016-10-18 185 Verilog+Code

用VERILOG语言实现了常用3-8译码器.

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2014-01-19 150 Verilog+Code

一百多个例子很好的verilog 学习资料

一百多个例子很好的verilog 学习资料，大家可以多多参考，适合初学者学习

2013-12-22 157 Verilog+Code

有关verilog的硬件实现VGA设计的代码。

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2016-09-05 76 Verilog+Code

关于verilog的各个基本模块的源代码

关于verilog的各个基本模块的源代码，如加法器，寄存器，选择器及各个测试文件

2014-01-01 192 Verilog+Code

本程序（状态机）使用Verilog HDL语言编写

本程序（状态机）使用Verilog HDL语言编写，并通过QuestaSim仿真。

2013-12-26 40 Verilog+Code

上海大学 Verilog PPT 适合初学者看推荐

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2016-09-21 61 Verilog+Code

Verilog module containing a synthesizable CRC function // * polynomial: (0 1 8) // * data width: 8

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2016-09-26 158 Verilog+Code