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VHDL语言的加法器，在QuartusII9.0中用VHDL代码实现加法器。
浮点加法器的VHDL算法设计 浮点加法器的VHDL算法设计
用VHDL语言仿真乘法器设计。能够实现一般乘法运算。
用VHDL语言在CPLD/FPGA上实现浮点运算的方法
乘法器的vhdl语言描述.本人调试已经通过
用VHDL语言编程实现2维图像的滤波算法，简单精辟
八位乘法器VHDL语言实现。使用的工具的ISE7.1，实现八乘八的位相乘。
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