可综合的VerilogHDL设计实例: ---简化的RISC 8位CPU设计简介---
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UTF-8技术资料
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用89C51串行口外接CD4094移位寄存器扩展8位并行口
用89C51串行口外接CD4094移位寄存器扩展8位并行口，8位并行口的每位都接一个发光二极管，要求发光二极管从左到右以一定延迟轮流显示，并不断循环。...
8阶对称系数FIR滤波器分布式算法的实现代码
8阶对称系数FIR滤波器分布式算法的实现代码...
用verilog实现fir滤波器,实现了一个8阶的fir滤波器
用verilog实现fir滤波器,实现了一个8阶的fir滤波器...
8位七段码动态扫描控制VHDL设计。动态扫描模块
8位七段码动态扫描控制VHDL设计。动态扫描模块，延时模块，译码模块。设计采用状态机思路。...
在VGA显示器上显示8色竖彩条,使用verilog语言编写
在VGA显示器上显示8色竖彩条,使用verilog语言编写，quartusII编译成功...
分频器 8分频器 50 已经测试 可以用 代码可更改
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4×4键盘及8位数码管显示构成的电子密码锁
4×4键盘及8位数码管显示构成的电子密码锁...
一种基于加法器树方法的8为乘法器的VHDL源码
一种基于加法器树方法的8为乘法器的VHDL源码，该方法虽然相对占有资源多，但仿真快...
EX5_7SEG: （数码管） 8位数码管显从左至右依次显示0-7。
EX5_7SEG: （数码管） 8位数码管显从左至右依次显示0-7。...