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💻 源代码:3620
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SystemVerilog(SV)是一种强大的硬件描述与验证语言,广泛应用于数字电路设计、仿真及验证。它不仅继承了Verilog的高效性,还引入了面向对象编程特性,极大提升了复杂系统的设计效率与可测试性。无论是初学者还是资深工程师,都能从SV中找到提升技能的新途径。本页面汇集了26个精选SV资源,涵盖基础教程到高级应用案例,助您快速掌握这一关键技能,在IC设计领域游刃有余。

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超宽带系统链路matlab仿真程序 超宽带系统简单仿真平台,有简单界面.包括可替换的脉冲成型(半余弦脉冲)、IEEE802.15.3a的修正SV信道、最大似然信道估计、Rake接收机等模块,可以实现monte carlo仿真求误码率。可添加多址接入、编码等功能(维特比编解码、帧同步的程序由...

📅 👤 duoshen1989

自己编写的超宽带系统简单仿真平台,有简单界面.包括可替换的脉冲成型(半余弦脉冲)、IEEE802.15.3a的修正SV信道、最大似然信道估计、Rake接收机等模块,可以实现monte carlo仿真求误码率。可添加多址接入、编码等功能(维特比编解码、帧同步的程序由本人同学编写)。入口主程序uwbsi...

📅 👤 redmoons

主要自己写的,基于SV-C多径信道,设计传输速率100Mbps,借用了几个别人的函数。...

📅 👤 JasonC

设计一台微机控制的数控直流电压源,为电子设备供电。 在设计过程中,选择1~2个单元电路使用仿真软件(例如Multisim2001等)进行仿真调试。 用计算机绘制所有的电路图和印刷电路图 1.1.2设计要求 输出电压范围0-30v,步进值为0.1V 电压调整率Sv<0.05%V; 电...

📅 👤 xc216

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