RISC+OS
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这是一个Verilog HDL编写的RISC cpu的程序，该程序共10个子程序，实现了简单的RISC cpu，可供初学者参考，学习硬件描述语言，及设计方法。该程序通过了modelsim仿真验证。
2015-03-26
138
verilog RISC8 cpu CORE 8位RISC CPU 内核源码（VERILOG 版）
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2017-02-18
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