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https://www.eeworm.com/dl/663/213391.html VHDL/FPGA/Verilog

用verilog编写的risc mcu

用verilog编写的risc mcu
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https://www.eeworm.com/dl/534/456647.html 其他

一款8位RISC MCU的设计.........

一款8位RISC MCU的设计.........
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https://www.eeworm.com/dl/508721.html VHDL/Verilog/EDA源码

RISC—cpu

通过modelsim软件编写源代码并且仿真实现 精简的CPU设计
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https://www.eeworm.com/dl/655/124180.html 微处理器开发

这是一个很好的Verilog 编写的8位RISC CPU源码（可做为MCU）

这是一个很好的Verilog 编写的8位RISC CPU源码（可做为MCU），并且包括完整的C 语言的测试代码。
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https://www.eeworm.com/dl/663/419658.html VHDL/FPGA/Verilog

RISC（reduced instruction setcomputer

RISC（reduced instruction setcomputer，精简指令集计算机）是一种执行较少类型计算机指令的微处理器。改源码是vhdl语言，能在FPGA上跑。
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https://www.eeworm.com/dl/1012054.html 技术资料

RISC源程序

基于Verilog HDL实现的RISC架构源代码，经过多个项目验证，可直接用于教学或实际开发，涵盖指令集设计与核心模块实现，适合深入理解精简指令集原理。
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https://www.eeworm.com/dl/534/383287.html 其他

Verilog-RISC CPU 代码 实现了简单的RISC cpu

Verilog-RISC CPU 代码 实现了简单的RISC cpu，可供初学者参考，学习硬件描述语言，及设计方法。该程序通过了modelsim仿真验证。 北航
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https://www.eeworm.com/dl/903091.html 技术资料

RISC乘累加单元的扩展Extended RISC MAC Unit

本文设计了扩展的乘累加单元(DSPMAC)，用于运算速度的提高。基于or1200 乘累加单元，运用RISC技术和并行操作，通过开发32-bit 指令中的保留位，在资源占用增幅较少和一定的功耗及温
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https://www.eeworm.com/dl/1018867.html 技术资料

mcu-mcu

适用于嵌入式开发的高效MCU通信方案，支持多种协议栈实现，经过多个工业项目验证，可直接用于生产环境的稳定代码模块。
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https://www.eeworm.com/dl/687/176019.html 其他嵌入式/单片机内容

RISC processor ARM-7 emulator

RISC processor ARM-7 emulator
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