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2023-06-03
10
CPLD数字电路设计-使用MAX+plusⅡ入门篇-555页-21.1M.pdf
专辑类-可编程逻辑器件相关专辑-96册-1.77G CPLD数字电路设计-使用MAX+plusⅡ入门篇-555页-21.1M.pdf
2023-07-08
8
CPLD数字电路设计--使用MAX+plusⅡ入门篇-555页-21.1M.rar
tyw 专辑类----可编程逻辑器件相关专辑 CPLD数字电路设计--使用MAX+plusⅡ入门篇-555页-21.1M.rar
2023-07-15
3
包含了电子时钟的主要功能,输入CLK为1KHZ,输出为动态扫描8段CLD显示.有闹铃,正点报时,时间调整.调整时能够闪烁显示.本时钟为24小时制.课程设计优秀通过.运行平台:MAX+PLUS2.
包含了电子时钟的主要功能,输入CLK为1KHZ,输出为动态扫描8段CLD显示.有闹铃,正点报时,时间调整.调整时能够闪烁显示.本时钟为24小时制.课程设计优秀通过.运行平台:MAX+PLUS2.
2016-03-06
193
This a sample write in VBNet to use a free Brettle.Web.NeatUpload.dll in aspnet to upload file max t
This a sample write in VBNet to use a free Brettle.Web.NeatUpload.dll in aspnet to upload file max to 2G. I try in IIS a...
2014-07-06
100
这些程序我用MAX+PlusII软件测试均能通过编译
这些程序我用MAX+PlusII软件测试均能通过编译，程序本身不复杂，旨在为刚接触VHDL语言的朋友提供一些样例，以便了解VHDL语言的基本构成。如果要运行测试，则新建文件名应于程序中实体名一致，文件后缀“.vhd”，不推荐直接通过复制、粘...
2014-01-09
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