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max-log-map算法的C语言的实现，能计算出所需要的LLR，做出软判决和硬判决。
MAX+PLUS 技术资料
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压缩工程
利用EDA工具MAX-PlusII的VDHL输入法，输入VHDL程序，实现2位计数器，在七段译码器上以十进制显示：0、1、2、3、0、...。时钟信号使用83管脚。采用自动机状态转换方式设计该计数器；建立相应仿真波形文件，并进行波形仿真；分析设计电路的正确性。
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可编程逻辑器件相关专辑 96册 1.77GMAX+plusⅡ入门篇 574页 17.7M 书签版.pdf
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