LPC master verilog source（内附LPC标准协议文档）
用户接口Wishbone bus 接口， 驱动LPC master去主动访问 slave 寄存器表（地址可更改） 读取到寄存器封装到用户层 可按要求更改设计
2020-05-21
LPC编码器
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2013-05-21
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LPC总线接口UART控制器FPGA实现
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2023-06-13
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