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Ise

用中文介绍Xilinx公司FPGA/CPLD的集成开发环境－Ise软件的简单使用

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Ise MIG1.6 生成的DDR SDRAM控制器代码（含TESHBENCH）

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Ise的简单使用说明

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VHDL Xilinx Ise 9.1i

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扩频接收机设计实例,vhdly源代码!大家下载下来吧,在Ise中调试通过

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vga显示代码,里面有Ise工程文件,是直接调过去的,大家下载下来吧

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开发环境是QUARTUSI,Ise等FPGA开发工具

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在Ise下用verilog开发的16位进位现行加法器

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在Ise环境下用VHDL写的8*9FIFO

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xilinx Ise 实例代码。可用Ise直接打开

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