源码文件
'timescale 1ns/1ns module test1; reg A,B,C; initial begin A = 0; B = 1; C = 0; #100 C = 1; #100 A = 1; B = 0; #100 A…
ICCAVR-V 源代码
iCCavr-V是一款专为AVR微控制器设计的强大编程工具，支持广泛的芯片型号，适用于工业控制、智能家居及嵌入式系统开发等多个领域。其友好的用户界面与丰富的功能选项，极大地简化了开发流程，是电子工程师不可或缺的利器。虫虫下载站提供1063个iCCavr-V相关资源，涵盖从入门教程…
收录资源 500 份
全站深度检索
共匹配 500 份工程资源
· 第 25 / 50 页
源码文件
module test2; reg clk1,clk2; parameter CYCLE = 100; always begin {clk1,clk2} = 2'b10; #(CYCLE/4) {clk1,clk2} …
源码文件
primitive carry_udpx1(cout,cin,a,b); input cin,a,b; output cout; table // cin a b : cout 0 0 0 : 0; 0 1 0 :…
源码文件
module latch_16(qo,din,load); output[15:0] qo; input[15:0] din; input load; reg[15:0] qo; always @(posedge load) begin qo…
源码文件
module count10(out,cout,en,clr,clk); output[3:0] out; output cout; input en,clr,clk; reg[3:0] out; always @(posedge clk or …
源码文件
module longframe1(clk,strb); parameter delay=8; input clk; output strb; reg strb; reg[7:0] counter; always@(posedge clk) …
源码文件
module resource1(sum,a,b,c,d,sel); parameter size=4; output[size:0] sum; input sel; input[size-1:0] a,b,c,d; reg[size:0] sum;…
源码文件
module longframe2(clk,strb); parameter delay=8; input clk; output strb; reg[7:0] counter; reg temp; reg strb; always@(po…
源码文件
module block2(Q0,Q1,Q2,Q3,din,clk); output Q0,Q1,Q2,Q3; input clk,din; reg Q0,Q1,Q2,Q3; always @(posedge clk) begin …
源码文件
module block1(Q0,Q1,Q2,Q3,din,clk); output Q0,Q1,Q2,Q3; input clk,din; reg Q0,Q1,Q2,Q3; always @(posedge clk) begin …