HDL+Testing

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基于Verilog HDL实现的数字时钟设计，包含完整计数器逻辑与系统架构方案，适用于数字电路开发与FPGA学习。提供详细设计报告，涵盖模块划分与代码实现。

2026-03-01 2 HDL+Testing

解决核电厂安全仪控系统开发中的HDL编程难题，掌握Verilog与VHDL在A类功能系统中的应用，提升安全关键电路设计能力。

2026-03-22 3 HDL+Testing

·[测试书籍]ESSENTIALS OF ELECTRONIC TESTING FOR DIGITAL, MEMORY AND MIXED-SIGNAL VLSI CIRCUITS 

2013-07-21 41 HDL+Testing

·[测试书籍]ESSENTIALS OF ELECTRONIC TESTING FOR DIGITAL, MEMORY AND MIXED-SIGNAL VLSI CIRCUITS 

2024-07-03 10 HDL+Testing

This model is just testing an idea of MIMO, which IEEE802.11n will have. But I havo not seen the standard, I tried to ...

2013-12-25 182 HDL+Testing

It s application source code for delphi. it can be use for testing ATCommand if you want to play with SMS gateway.

2013-12-11 122 HDL+Testing

2014-01-05 34 HDL+Testing

以verilog HDL 语言编写的一首歌曲，可供初学者借鉴

2013-09-05 118 HDL+Testing