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68013 gpif模式的使用说明,详细代码可以在众山公司下载
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CY7c68013 GPIF程序绝对可用
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EZ-USB的CY7C68013A实现Slave FIFO的AutoIN。关键配置见TD_Init函数。
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一个异步的FIFO的VERILOG程序,有测试程序
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FIFO的VHDL编程，其中包括FIFO的读，写，满帧，半满帧信号驱动
压缩工程
同步FIFO功能，verilog语言描述，通过了modelsim 6.0 仿真，Quartue综合
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一个比较经典的用VHDL实现的FIFO论文
电路图纸
用Verilog语言编写的实现NAND Flash块的控制存取以及同步的FIFO的控制
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C++写的操作系统原理及实现,模拟页面置换算法FIFO的源码
电路图纸
This an USB2.0 chip CY7C68013 Configuraion Example for Slave FIFO mode with "async" mode.