USB 到 UART 协议转换程序 [简易的 - 少量的FIFO] 目标 MCU :AT90S2313-10
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通过一个主时钟信号完成异步FIFO读写时钟信号的产生。编译通过实现功能。
一个操作系统试验 虚拟存储器页面转换FIFO算法模拟实现
This code is a FIFO memory vhdl developed in ISE Software
异步FIFO控制器的设计 主要用于异步先进先出控制器的设计。 所用语言Verilog HDL.
电子EDA,VHDL语言设计8位的fifo数据缓冲器的vhdl源程序
通用存储器VHDL代码库,The Free IP Project VHDL Free-FIFO, Quartus standard library.
该文件是16*16位先入先出fifo的源代码
FIFO程序库,添加即可使用,一个非常实用的程序...
simple client/server in socket and fifo in c better run in linux.