FPGA设计流

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本文介绍了一个基于CPLD／FPGA的嵌入式IP核设计。论文在阐述可编程逻辑器件及其发展趋势的基础上，探讨了知识产权复用理念，MCU的复杂化设计以及数字信号传输与处理的速度要求。结合国内外对CPLD／FPGA的使用现状，引出了在CPLD／F...

2013-07-05 187 FPGA设计流

用FPGA实现大型设计时，可能需要FPGA具有以多个时钟运行的多重数据通路，这种多时钟FPGA设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何...

2016-04-03 107 FPGA设计流

采用最新FPGA开发技术架构，实现高精度数字钟系统。基于Verilog硬件描述语言，结合时序逻辑与状态机设计，具备良好的可扩展性与稳定性。

2026-03-09 1 FPGA设计流