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基于DVBS标准的射频调制器设计与FPGA实现
用FPGA实现频率计并通过LCD显示,是很不错的代码
使用verilog编写分频器,包括奇分频和偶分频,可以进行任意奇偶分频
vhdl语言描述分频器,实现2、4、8、16……分频,经过实践
verilog分频器~时钟为50hmz,波特率采用9600bps~
用vhdl实现的分频器,可产生任意对主时钟的分频,从而是实现不同频率pwm的控制
相位分频器源代码,正确,测试通过
实用电子技术专辑 385册 3.609G上分器制作 视频.wmv
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