FPGA+IP核

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阐述H.264/AVC 二进制算术编码的原理，论述此编码的IP 核设计方案及其FPGA 验证。整个设计使用VerilogHDL 语言描述，在 ALDEC 的Active_HDL6.2 平台上进行时序仿

2024-05-13 8 FPGA+IP核

2016-03-06 50 FPGA+IP核

FPGA内NIOSII核的并口，串口的初始化及其开发

2014-07-02 183 FPGA+IP核

以FPGA芯片为核心，扩展必要的外围电路，制作一个16*16LED点阵的汉字显示屏，使之能显示16*16LED点阵的汉字4个，如“一”，“二”，“三”，“四”等。要求显示的汉字无闪烁。每个汉字停留时间1秒。

2017-05-24 56 FPGA+IP核

2014-08-16 162 FPGA+IP核

设计了一款基于Avalon总线的8051MCU IP核。它支持MCS-51指令集，优化内部的结构，通过采用流水线技术、指令映射技术、指令预取技术、微代码技术等极大的提高了IP核的工作速度，使IP核在100MHz时钟下，能够单周期执行一条指令...

2013-11-02 107 FPGA+IP核

BIST 电路IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。

2013-12-15 151 FPGA+IP核

SoC-Wishbone System IP核的VHDL语言源代码，需要的开发环境是QUARTUS II 6.0。

2014-01-13 97 FPGA+IP核