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找到约 131 项符合 DDR 的查询结果

PCB相关 DDR布线规范.rar

DDR,SDRAM原理介绍、相关信号线介绍及时序,附各图片。
https://www.eeworm.com/dl/501/9138.html
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教程资料 ALLEGRO 约束规则设置步骤(以DDR 为例)

ALLEGRO 约束规则设置步骤(以DDR 为例)
https://www.eeworm.com/dl/cadence/doc/17439.html
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教程资料 nois中基于c的ddr等存储器的checksum的实现

nois中基于c的ddr等存储器的checksum的实现.
https://www.eeworm.com/dl/fpga/doc/18321.html
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教程资料 ALLEGRO 约束规则设置步骤(以DDR 为例)

ALLEGRO 约束规则设置步骤(以DDR 为例),同样为pdf格式方便大家下载使用
https://www.eeworm.com/dl/cadence/doc/18660.html
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教程资料 用allegro画的ddr存储器电路-六层板设计

用allegro画的ddr存储器电路。六层板设计,很好的参考资料
https://www.eeworm.com/dl/cadence/doc/18766.html
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PCB相关 DDR内存布线指导,DDR_Layout_Guide_[1]..

DDR内存布线指导,DDR_Layout_Guide。
https://www.eeworm.com/dl/501/21631.html
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PCB相关 DDR走线要点

DDR走线要点。
https://www.eeworm.com/dl/501/21743.html
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PCB相关 SDRAM与DDR布线指南

SDRAM与DDR布线指南
https://www.eeworm.com/dl/501/21920.html
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教程资料 XAPP806 -决定DDR反馈时钟的最佳DCM相移

This application note describes how to build a system that can be used for determining theoptimal phase shift for a Double Data Rate (DDR) memory feedback clock. In this system, theDDR memory is controlled by a controller that attaches to either the OPB or PLB and is used inan embedded microproces ...
https://www.eeworm.com/dl/fpga/doc/32600.html
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可编程逻辑 DDR内存布线指导,DDR_Layout_Guide_[1]..

DDR内存布线指导,DDR_Layout_Guide。
https://www.eeworm.com/dl/kbcluoji/38893.html
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