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液晶初学者可以使用该程序进行初步调试，加深对液晶算法的认识
一个简单的对M25P64驱动测试。包括底层读写及测试。
DDR RAM控制器的VHDL源码，实现平台是Lattice FPGA，功能验证通过
DDR内存布线指导,DDR_Layout_Guide。
从手机输出log，记录DDR时序Pass和fail的信息，导入此工具，分析出最佳时序配置。
该文档为DDR布线的一些总结，具有一定的参考价值
基于DDR SDRAM控制器时序分析的模型，仅提供参考
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