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本文使用Verilog 实现一个简单的3-8 译码器，并在硬件上验证，供FPGA 初学者参考。
3-8译码器和8-3BCD七段显示译码器
802.3an ldpc码编码、译码设计，使用VERILOG hdl语言编写，包括测试代码，
卷积码的编码和译码，采用维特比译码，并且给出了编码和未编码的性能比较.
huffman 编码与译码 对任意文件二进制的编码与译码
turbo 码matlab编译码程序，包括map和siso译码算法
2,1,7卷积码译码s-function
RS 码的编译码程序，对编码分析有一定的帮助，采用迭代译码算法.
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