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CRC_Table 的查询结果
VHDL/FPGA/Verilog crc_table.c is for reset seed( 0000 ) crc_table_1.c is for reset seed( ffff) CRC16_D8_m.v is a ver
crc_table.c is for reset seed( 0000 )
crc_table_1.c is for reset seed( ffff)
CRC16_D8_m.v is a verilog module of byte paralle crc.
CRC16_D8_m_tb.v is the testbench file of above module.
matlab例程 C 程序 球面方位角算法： azimuth.cpp CRC校验快速算法： CRC_Table.cpp 解扰码算法： scrambler.cpp Matlab 程序 信号带宽测量： Ba
C 程序
球面方位角算法： azimuth.cpp
CRC校验快速算法： CRC_Table.cpp
解扰码算法： scrambler.cpp
Matlab 程序
信号带宽测量： BandWith.m
带通信号下变频： fqmv.m
QPSK 解调 demodQpsk.m
pwelch求功率谱的算法 psdwh.m
均值滤波算法 cvmn.m
信号正交分解： Cnv2Bas.m ...