CPLD

CPLD采用CMOSEPROM、EEPROM、快闪存储器和SRAM等编程技术,从而构成了高密度、高速度和低功耗的可编程逻辑器件。cPCI总线

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2026-01-15 3 CPLD

适用于数字电路设计与可编程逻辑开发的实战指导,涵盖VerilogHDL语言基础及CPLD-FPGA器件应用。帮助工程师快速掌握硬件描述语言与开发流程,提升项目开发效率。

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JTAG CPLD实现源代码,比用简单并口调试器快5倍以上。\r\n以前总觉得简单的并口jtag板速度太慢,特别是调试bootloader的时候,简直难以忍受。最近没什么事情,于是补习了几天vhdl,用cpld实现了一个快速的jtag转换板...

2013-09-04 51 CPLD