CPLD管脚分配

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工作原理：\r\n 脉冲输入，记录30个脉冲的间隔时间（总时间），LED显示出来，牵涉到数码管的轮流点亮，以及LED的码。输入端口一定要用个\r\n74LS14整一下，图上没有。数码管使用共阴数码管。MAXPLUS编译。\r\n测试时将光电...

2013-09-05 121 CPLD管脚分配

难得一见的CPLD与FPGA开发板常见警告错误全记录，涵盖睿智开发板典型问题及解决方案，技术细节详实，适合调试与故障排查。

2026-03-13 3 CPLD管脚分配

基于ALTERA Maxplus II平台与ACEX芯片实现三相电压型逆变器的优化SVPWM算法，融合Kohonen神经网络优势提升计算效率，降低开关损耗。采用CPLD实现逻辑控制，结构简洁且运行稳定。

2026-02-18 1 CPLD管脚分配