CLK模块
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密钥扩展模块的接口如图4.4。clk为系统时钟，kld为输入的加载信号，key为输入的128位密钥数据，wo_0, wo_1, wo_2, wo_3分别为输出的密钥列
2014-01-14
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2015-06-24
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8 reset-ad-da-clk-power.pdf
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2024-10-31
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MSP430FG46xx source code, ADC, CLK, DAC, DMA, USART, USCI
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2016-07-30
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