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嵌入式综合  基于BWDSP指令Cache的PLRU替换算法研究

通过BWDSP模拟器对目前常用的几种替换算法和大小不同的指令Cache块进行仿真实验得出不同缺失率。实验结果表明，所提出的PLRU替换算法性能高于LRU、LFU、FIFO替换算法，并使BWDSP整体性能提高到为其他三种替换算法的1.12倍左右。

https://www.eeworm.com/dl/566/34568.html

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嵌入式综合  CACHE实战技巧

CACHE对于CPU来说非常重要，它们是处理器和内存等数据交换的高速缓冲地带，可以对使用过的数据和指令进行有选择的保留，以便以后直接调用，这样将大大提高系统的速度。

https://www.eeworm.com/dl/566/35940.html

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其他嵌入式/单片机内容  计算机体系结构中cache实现原理及解决方案的模拟程序.

计算机体系结构中cache实现原理及解决方案的模拟程序.

https://www.eeworm.com/dl/687/134599.html

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DSP编程  cache测试软件

cache测试软件，通过该小程序可以了解一些有关cache工作原理．

https://www.eeworm.com/dl/516/135612.html

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Java编程  一个不错的cache

一个不错的cache，不但能够实现map的所有操作，而却具有内嵌的集群支持能力

https://www.eeworm.com/dl/633/151896.html

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数据结构  使用LRU方法更新Cache 结合数据结构的相关知识

使用LRU方法更新Cache 结合数据结构的相关知识，使用LRU的策略，对一组访问序列进行内部的Cache更新并附实验报告

https://www.eeworm.com/dl/654/161132.html

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VHDL/FPGA/Verilog Arm9指令Cache缓存模块的verilog代码

Arm9指令Cache缓存模块的verilog代码，对一些做ARM硬件开发的朋友有参考价值。

https://www.eeworm.com/dl/663/163265.html

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数学计算  cache: you will be given a char at will and you should simulate the computer s memory and cache .

cache: you will be given a char at will and you should simulate the computer s memory and cache .

https://www.eeworm.com/dl/641/171512.html

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DSP编程  Blakcfin processor Cache code example

Blakcfin processor Cache code example

https://www.eeworm.com/dl/516/177246.html

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VHDL/FPGA/Verilog 一个32位微处理器的verilog实现源代脉,采用5级流水线和cache技术.

一个32位微处理器的verilog实现源代脉,采用5级流水线和cache技术.

https://www.eeworm.com/dl/663/182385.html

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