Brent-Kung加法器

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VHDL语言的加法器，在QuartusII9.0中用VHDL代码实现加法器。

2025-02-20 9 Brent-Kung加法器

代码是用verilog编写的加法器的源代码，有进位选择，连波进位，还有进位跳跃多种方法描述全加器

2025-02-20 8 Brent-Kung加法器

2014-01-13 43 Brent-Kung加法器

两个浮点数相加的加法器，使用verilog编写

2016-07-22 95 Brent-Kung加法器

在VIVADO下用verilog语言实现加法器与减法器，溢出会提示，负值会提示

2023-01-16 8 Brent-Kung加法器

8位相加乘法器，具有高速，占用资源较少的优点

2014-08-06 127 Brent-Kung加法器

16位高速加法器，采用verilog语言编写，已经成功仿真，能够运行

2013-12-24 167 Brent-Kung加法器

加法器的VHDL代码，可以在很多地方直接应用

2013-12-31 142 Brent-Kung加法器