搜索：BlockRAM

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共 16 条结果
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https://www.eeworm.com/dl/663/397390.html VHDL/FPGA/Verilog

xilinx BlockRAM 级联

xilinx BlockRAM 级联，利用Xilinx原语（非IP Core），更大灵活性
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https://www.eeworm.com/dl/663/397392.html VHDL/FPGA/Verilog

verilog语言实现

verilog语言实现，利用BlockRAM实现FIFO。
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https://www.eeworm.com/dl/684/266335.html 软件设计/软件工程

SDRAM 参考设计:主要包括The following figure shows a high-level block diagram for this reference design follo

SDRAM 参考设计:主要包括The following figure shows a high-level block diagram for this reference design followed by a brief description of each sub-section. The design consists of: · PowerPC processor · PLB-OPB bridge · BlockRAM Memory Controller · SDRAM Controller · Two GPIO ...
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https://www.eeworm.com/dl/556/12894.html XILINX FPGA开发软件

chipscop7.1i.rar

ChipScope Pro具有传统逻辑分析仪的功能，是针对Xilinx Virtex Pro等系列FPGA的在线片内信号分析工具，主要功能是通过JTAG口，实时、在线、方便地观察到FPGA内部的信号，给调试、故障定位提供极大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根据用户设定的触发条件将信号实时的保存 ...
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https://www.eeworm.com/dl/922550.html 技术资料

chipscop7.1i.rar

ChipScope Pro具有传统逻辑分析仪的功能，是针对Xilinx Virtex Pro等系列FPGA的在线片内信号分析工具，主要功能是通过JTAG口，实时、在线、方便地观察到FPGA内部的信号，给调试、故障定位提供极大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根据用户设定的触发条件将信号实时的保存 ...
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https://www.eeworm.com/soft/48.html 精品软件

CHIPSCOP7.1I.RAR

ChipScope Pro具有传统逻辑分析仪的功能，是针对Xilinx Virtex Pro等系列FPGA的在线片内信号分析工具，主要功能是通过JTAG口，实时、在线、方便地观察到FPGA内部的信号，给调试、故障定位提供极大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根据用户设定的触发条件将信号实时的保存 ...
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https://www.eeworm.com/dl/906263.html 技术资料

FPGA与SRAM相结合完成大容量数据存储

随着数字信号处理技术的不断发展，大容量可编程逻辑器件的不断涌现，FPGA技术越来越多地应用在大规模集成电路设计中。在此硬件系统设计中，经常会遇到需要大容量的数据存储的情况，下面我们将针对FPGA中内部BlockRAM有限的缺点，提出了将FPGA与外部SRAM相结合来改进设计的方法，并给出了部分VHDL程序。 ...
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https://www.eeworm.com/dl/514/10029.html 学术论文

基于FPGA的DES加密系统设计与实现

本文设计实现了一种基于FPGA的DES加密系统。 概括起来，本文主要完成了以下几方面的主要工作：完成了DES加密系统的整体设计。整个系统包括DES加密核心模块，UART通信接口模块和BLOCKRAM存储模块。以EITS2003开发板为硬件开发平台，ISEwebpack为开发软件，用Verilog硬件描述语言设计并且实现了三大模块 ...
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https://www.eeworm.com/dl/901388.html 技术资料

基于FPGA的DES加密系统设计与实现

本文设计实现了一种基于FPGA的DES加密系统。 概括起来，本文主要完成了以下几方面的主要工作：完成了DES加密系统的整体设计。整个系统包括DES加密核心模块，UART通信接口模块和BLOCKRAM存储模块。以EITS2003开发板为硬件开发平台，ISEwebpack为开发软件，用Verilog硬件描述语言设计并且实现了三大模块 ...
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https://www.eeworm.com/dl/933964.html 技术资料

二维9_7整数离散小波变换的FPGA设计

·摘　要:采用流水线设计技术和模块化设计思想,提出一种基于CCSDS新推荐标准的图像数据压缩算法中二维9/7整数离散小波变换的实时并行实现结构。结构主要由行变换、列变换和行缓存等模块组成,行、列变换可并行进行。使用FPGA内嵌的BlockRAM作为行缓存器,减少了外部存储器的使用、访问以及时间延迟。结果 ...
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