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基于QT的加法器的实现,里边包括图形大概设计,为真正的QT编程创造很好的条件,通过看里边的代码,可以提供很多的服务。
VHDL语言的加法器,在QuartusII9.0中用VHDL代码实现加法器。
代码是用verilog编写的加法器的源代码,有进位选择,连波进位,还有进位跳跃多种方法描述全加器
BCD码相乘,汇编环境里没有对压缩BCD码相乘的调整,相当于作业吧!
binary to bcd conversion
bcd码转换,用于将4位2进制码转为7位BCD码子函数
Binary to BCD converter
浮点加法器的VHDL算法设计 浮点加法器的VHDL算法设计
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