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Altera Sdram IP 源码，VHDL写的
ALTERA上DE2平台，使用LCD模块，在LCD上显示字母字符。与已有程序相比，程序更加优化，代码更少。
ALTERA上DE2平台，利用内部50M Hz时钟，在数码管模拟显示时间(时分秒)。
ALTERA上DE2平台，verilog描述，无符号乘法器，在数码管显示结果。
难得一见的ALTERA DE2 RS232完整代码，涵盖底层通信逻辑与硬件交互细节，适合嵌入式开发入门与实践参考。
ip_51core VHDL ALTERA Cyclone II
Altera Quartus to Pll Source
主要讲述了altera公司的dsp builder的使用，通过本教程，我们可以更好的理解dsp
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