Altera+SOPC

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ALTERA上DE2平台，利用内部50M Hz时钟，在数码管模拟显示时间(时分秒)。

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ALTERA上DE2平台，verilog描述，无符号乘法器，在数码管显示结果。

2013-12-13 191 Altera+SOPC

altera NiosII   Hardware Design with SOPC Builder

2020-09-20 12 Altera+SOPC

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