Altera+IP

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文通过ALTERA公司的quartus II软件，用Verilog HDL语言完成多功能数字钟的设计。主要完成的功能为：计时功能，24小时制计时显示；通过七段数码管动态显示时间；校时设置功能，可分别设置时、分、秒；跑表的启动、停止、保持显...

2013-12-09 101 Altera+IP

2013-12-11 89 Altera+IP

Altera 的DE2开发套件的说明书，里面有部分程序，可供参考

2013-12-22 95 Altera+IP

Altera的CycloneIII Start Board,使用的PFGA是3C25，包括原理图和PCB，用Cadence Allegro打开

2016-11-19 167 Altera+IP

altera fpga ep3c25器件微处理器开发，niosii+sram, 已编译通过，可直接下载到开发板

2017-06-16 181 Altera+IP

可编程逻辑器件相关专辑 96册 1.77GAltera FPGA／CPLD设计高级篇 335页 23.6M.pdf

2014-05-05 91 Altera+IP

可编程逻辑器件相关专辑 96册 1.77GAltera FPGA／CPLD设计基础篇 332页 24.5M.pdf

2014-05-05 63 Altera+IP

5款altera的FPGA开发板原理图，详细介绍了板子的构成及功能

2014-01-12 48 Altera+IP