Active-HDL
Active-HDL是一款功能强大的硬件描述语言仿真工具，专为FPGA/CPLD设计验证而生。它支持VHDL、Verilog和SystemC等多种语言，提供直观的图形界面与高效的调试环境，极大提升了数字电路开发效率。无论是初学者还是资深工程师，都能通过丰富的示例项目快速掌握复杂系统的设计技巧。加入我...
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Active-HDL 热门资料
查看全部 809 份 →本书介绍了大量verilog HDL程序设计的实例
本书介绍了大量verilog HDL程序设计的实例，对于verilog语言学习者和从事相关工作的工程师来说，都有一定的学习和参考价值。
2014-01-17
72
ABEL 语言参考书 详细介绍了ABEL的语法 是HDL硬件设计的初级语言. 对HDL硬件设计人员仍然有用.
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2014-01-23
154
源码级制作含有中文的PDF文件,不需要ACTIVE OCX,就可以自己创建PDF 文档.
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2014-01-11
195
Lotus Notes开发用的在线DHTML编辑器,基于Active X control 1. This rich text editor is based on the editor used
Lotus Notes开发用的在线DHTML编辑器,基于Active X control 1. This rich text editor is based on the editor used in an older sandbox...
2016-11-27
136
microsoft visual c++ 2005、windows mobile 5 远程控制PC.通过阅读项目源码能让你熟悉Active Sync RAPI
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2013-12-18
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第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型
第一章 数字信号处理、计算、程序、算法和硬线逻辑的基本概念 第二章 Verilog HDL设计方法概述 第三章 Verilog HDL的基本语法 第四章 不同抽象级别的Verilog HDL模型 第五章 基本运算逻辑和它们的Veri...
2016-02-08
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基于Verilpg-HDL的轴承振动噪声电压峰值检测
介绍模拟峰值电压的检测方式，叙述基于Verilpg-HDL与高速A/D转换器相结合所实现的数字式快速轴承噪声检测方法，给出相关的Verilpg-HDL主模块部分。
2024-03-15
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