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Active-HDL

Active-HDL是一款功能强大的硬件描述语言仿真工具，专为FPGA/CPLD设计验证而生。它支持VHDL、Verilog和SystemC等多种语言，提供直观的图形界面与高效的调试环境，极大提升了数字电路开发效率。无论是初学者还是资深工程师，都能通过丰富的示例项目快速掌握复杂系统的设计技巧。加入我...

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Active-HDL 热门资料

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Verilog HDL Synthesis, A Practical Primer

·Verilog HDL Synthesis, A Practical Primer

2013-04-24 102 Active-HDL

Verilog-HDL实践与应用系统设计

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2013-08-06 140 Active-HDL

Verilog HDL硬件描述语言的教程

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2015-04-04 136 Active-HDL

148个verilog hdl小程序（有很多testbench）——.

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2015-01-28 174 Active-HDL

hdl优化设计十大戒律-转载

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2014-05-29 37 Active-HDL

Verilog HDL 数字设计教程(贺敬凯)

　　Verilog HDL 数字设计教程【作者：贺敬凯；出版社：西安电子科技大学出版社】（本资料为ppt）　　内容简介：介绍了Verilog HDL语言，状态机设计，仿真，还有好几个可综合设计的举例，除了常见的，还有空调控制器的设计，饮...

2015-01-01 93 Active-HDL

基于Verilog HDL的I2C总线分析器

提出了采用Verilog HDL 设计I2C 总线分析器的方法，该I2C 总线分析器支持三种不同的工作模式：被动、主机和从机模式，并提供了嵌入式系统设计接口。通过硬件总体框架分析，分模块输入，

2024-01-19 9 Active-HDL

Testbench对HDL模块进行功能仿真

本书主要以HDL（verilog/vhdl）为例，详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧，涵概了测试的各个方面，是目前进行IC设计的同仁们最为推荐的一本宝典！！

2024-03-03 7 Active-HDL