8位乘法器

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8位的加法器设计，分4个工程完成的，用的是Quartus II软件。

2014-01-20 134 8位乘法器

8位加法器的实现，非流水线结构，很不错。我测试过，效率比较高

2016-04-25 167 8位乘法器

8位加法器的实现，仿真通过，并且包括仿真文件，在quartusii7.1下调试通过

2016-06-30 112 8位乘法器

verilog实现16*16位乘法器，带测试文件

2013-12-18 118 8位乘法器

用VHDL实现四位乘法器，不直接用乘法实现，一来节省资源，二来可提高速度！

2017-01-02 25 8位乘法器

基于FPGA编写的16位乘法器，verilog编写，分享给大家！

2025-11-20 10 8位乘法器

16位乘法器VerilogHDL源代码，适合于初学者

2024-10-14 10 8位乘法器

采用加法树流水线乘法构造八位乘法器，并分析设计的性能和结果在时钟节拍上落后的影响因素。

2017-07-15 161 8位乘法器