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32位单精度加法器,在嵌入式可能会用的到
verilog 32位加法器 代码
两个4bit超前进位加法器实现8bit加法器
4位比较器,通过vhdl语言实现的四位比较器
vhdl实现一个4位十进制加法技术器。。。上传源代码,和大家分享
用vhdl语言实现4位乘法器,已被测试过,可参考使用
Verilog写的 8 位超前进位加法器
基于maxplus2的八位加法器,已经通过仿真
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