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VHDL数字钟设计程序 设计要求 基本要求： 1、24小时计数显示； 2、具有校时功能（时，分） ； 附加要求： 1、实现闹钟功能（定时，闹响）；
2017-01-21
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1.走时,六位LED7段数码管接24小时制显示时钟。 2.一个按键实现选曲（2～3首歌），并且要将所选的曲号通过显示器显示出来。 3.一个按键用来实现播放，播放结束后正常显示时钟，一个按键用来实现停止。 4.通过单片机的P1口的...
2016-06-29
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