一种简单高效的MPEG-2 MP@HL视频解码器
本文基于数据驱动原理提出并用 FPGA 实现了MPEG-2 MP@HL 的视频解码器。该解码器中的各个模块具有高内聚,低耦合的特点。只要各个模块符合数据驱动的工作方式,模块就能自我正常工作。由
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本文基于数据驱动原理提出并用 FPGA 实现了MPEG-2 MP@HL 的视频解码器。该解码器中的各个模块具有高内聚,低耦合的特点。只要各个模块符合数据驱动的工作方式,模块就能自我正常工作。由
·摘 要:为了减少视频编解码标准H.264/AVC中运动补偿模块插值结构的硬件复杂度,提出了一种高效插值结构,包括“串行输入并行输出”亮度插值结构和只需要2个乘法器和1个加法器的色度插值结构.该插值结构采用串行输入的维纳滤波器来产生水平半像...
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