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高压线性恒流芯片

  • TP4057 500mA线性锂离子电池充电器

    TP4057 一款完整的单节锂离子电池充电器,带电池正负极反接保护,采用恒定电流/恒定电压线性控制。其SOT封装与较少的外部元件数目使得TP4057 便携式应用的理想选择。TP4

    标签: 4057 500 TP mA

    上传时间: 2013-08-04

    上传用户:qiuqing

  • MPEG-2传送流特殊信息处理的FPGA实现研究

      本文介绍了如何利用FPGA(FieldProgrammableGateArray)技术来实现传送流特殊信息的处理,其主要内容如下:1.介绍了MPEG-2传送流系统层的语法规范;2.描述了传送流特殊信息之间的结构关系;3.简要介绍了传送流复用的原理和实现方法;4.详细讨论了如何用FPGA技术来实现对特殊信息的处理;整个项目的设计采用VHDL作为程序设计语言,都是以Xilinx的FPGA芯片及其ISE5.2i作为开发系统进行的。

    标签: MPEG FPGA 传送 信息处理

    上传时间: 2013-06-11

    上传用户:410805624

  • 基于FPGA的逆变器控制芯片研究

    逆变控制器的发展经历从分立元件的模拟电路到以专用微处理芯片(DSP/MCU)为核心的电路系统,并从数模混合电路过渡到纯数字控制的历程。但是,通用微处理芯片是为一般目的而设计,存在一定局限。为此,近几年来逆变器专用控制芯片(ASIC)实现技术的研究越来越受到关注,已成为逆变控制器发展的新方向之一。本文利用一个成熟的单相电压型PWM逆变器控制模型,围绕逆变器专用控制芯片ASIC的实现技术,依次对专用芯片的系统功能划分,硬件算法,全系统的硬件设计及优化,流水线操作和并行化,芯片运行稳定性等问题进行了初步研究。首先引述了单相电压型PWM逆变器连续时间和离散时间的数学模型,以及基于极点配置的单相电压型PWM逆变器电流内环电压外环双闭环控制系统的设计过程,同时给出了仿真结果,仿真表明此系统具有很好的动、静态性能,并且具有自动限流功能,提高了系统的可靠性。紧接着分析了FPGA器件的特征和结构。在给出本芯片应用目标的基础上,制定了FPGA目标器件的选择原则和芯片的技术规格,完成了器件选型及相关的开发环境和工具的选取。然后系统阐述了复杂FPGA设计的设计方法学,详细介绍了基于FPGA的ASIC设计流程,概要介绍了仅使用QuartusII的开发流程,以及Modelsim、SynplifyPro、QuartusII结合使用的开发流程。在此基础上,进行了芯片系统功能划分,针对:DDS标准正弦波发生器,电压电流双环控制算法单元,硬件PI算法单元,SPWM产生器,三角波发生器,死区控制器,数据流/控制流模块等逆变器控制硬件算法/控制单元,研究了它们的硬件算法,完成了模块化设计。分析了全数字锁相环的结构和模型,以此为基础,设计了一种应用于逆变器的,用比例积分方法替代传统锁相系统中的环路滤波,用相位累加器实现数控振荡器(DCO)功能的高精度二阶全数字锁相环(DPLL)。分析了“流水线操作”等设计优化问题,并针对逆变器控制系统中,控制系统算法呈多层结构,且层与层之间还有数据流联系,其执行顺序和数据流的走向较为复杂,不利于直接采用流水线技术进行设计的特点,提出一种全新的“分层多级流水线”设计技术,有效地解决了复杂控制系统的流水线优化设计问题。本文最后对芯片运行稳定性等问题进行了初步研究。指出了设计中的“竞争冒险”和饱受困扰之苦的“亚稳态”问题,分析了产生机理,并给出了常用的解决措施。

    标签: FPGA 逆变器 控制芯片

    上传时间: 2013-05-28

    上传用户:ice_qi

  • 基于ARM和DDS技术的压电陶瓷驱动电源设计

    DDS(Direct Digital Synthesis直接数字频率合成技术)是广泛应用的信号生成方法,其优点是易于程控,输出频率分辨率高,同时芯片的集成度高,适合于嵌入式系统设计。针对现有的压电陶瓷电源输出波形频率、相位等不能程控、电路集成度不高、体积和功耗较大等问题,本文以ARM作为控制电路核心,引入DDS技术产生输出的波形信号,并由集成高压运放将波形信号提高至输出级的电压和功率。 在压电陶瓷电源硬件电路中采用了模块化设计,主要分为ARM控制电路、DDS系统驱动电路和波形调理电路、高压运放电路等几个部分。电源控制电路以三星公司的S3C2440控制器为核心,以触摸屏作为人机输入界面;DDS芯片选用ADI公司的AD9851,设计了DDS系统外围驱动电路,滤波和信号调理电路,并应用了将DDS与锁相环技术相结合的杂散问题解决方案;高压运放电路由两级运放电路组成,采用了电压控制型驱动原理,放大电路的核心是PA92集成高压运放,加入了补偿电路以提高系统的响应带宽,并在电源输出设置了过电流保护和快速放电的放电回路。 电源软件部分采用WINCE嵌入式系统,根据WINCE系统驱动架构设计DDS芯片的流接口程序,编写了流接口函数和配置文件,并将流驱动程序集成入WINCE系统;编写了基于EVC的触摸屏人机界面主程序,由主程序将用户输入参数转换为DDS芯片的控制字,并采用动态加载流驱动方式将控制字送入DDS芯片实现了对其输出的控制。 对电源进行了不同典型波形输出的测试实验。在实验中,测试了DDS信号波形输出的精度和分辨率、电源动态输出精度和对信号波形的跟随性和响应性能。实验表明,压电陶瓷电源输出信号波形精度较高,对波形、频率等参数改变的响应速度快,达到电源输出稳定性要求。

    标签: ARM DDS 压电陶瓷 驱动

    上传时间: 2013-04-24

    上传用户:haoxiyizhong

  • 基于ARM和uCOS-Ⅱ的衍射仪高压控制系统研究与应用

    X射线衍射仪目前被广泛应用于冶金、石油、化工、科研、航空航天、教学、材料生产等诸多领域。而X射线管是X衍射仪的关键部件之一,X射线被激发时会产生两种谱线:特征谱线和连续谱线。X射线管的工作状态决定能否产生符合实验要求的X射线特征谱线和连续谱线,这就要求我们对X射线管的工作状态进行精确控制。 本文根据X射线管工作状态和衍射仪相关功能的要求,提出了基于ARM和uCOS-Ⅱ的衍射仪高压控制系统的设计方案,并在分析和研究的基础上,实现并验证了该方案。该系统以ARM为主控制芯片,结合CPLD芯片,完成对X射线管工作状态的控制和其它相关功能的控制。由于多任务的需要,在ARM的基础上引入了嵌入式操作系统uCOS-Ⅱ。具体的,本文完成了相应原理图和印刷电路板的设计。在ARM7芯片LPC2378上,完成了嵌入式操作系统uCOS-II的移植;在uCOS-II操作系统上,通过对ARM芯片编程,实现了对X射线管的工作状态进行精确控制,以及光闸、水循环等相关功能的控制。 上述系统已通过实际的安装调试。测试结果表明,该系统能够满足设计要求,实现全部的预期功能,可完成对X射线管的工作状态的精确控制,和衍射仪相关功能的控制。

    标签: uCOS ARM 衍射 压控

    上传时间: 2013-04-24

    上传用户:BK094

  • 10100M以太网芯片的I2C接口模块的FPGA设计

    该文结合"10M/100M以太网交换芯片的设计"课题,介绍了以太网技术发展的概况和IP CORE、SoC的设计方法,阐述了以太网交换原理及关键技术,研究了CSMA/CD协议、交换机、VLAN的原理和数据流优先技术及流量控制,在此基础上完成了10M/100M以太网交换芯片的主要模块的设计方案和实现框图.同时结合Philip公司的IC总线的工作原理,给出了10M/100M以太网交换芯片的设计方案中的IC接口模块的FPGA设计的验证和仿真,并对仿真结果进行分析比较,验证了IC接口模块可以作为一个软核来使用.

    标签: 10100M FPGA I2C 以太网

    上传时间: 2013-07-18

    上传用户:jichenxi0730

  • 基于ARM的开关磁阻电机驱动系统设计

    开关磁阻电机是电机技术与现代电力电子技术、微机控制技术相结合的产物,既具有结构简单坚固、成本低、容错能力强,耐高温等优点,又在高度发展的电力电子和微机控制技术的支持下获得了良好的可控性能,目前己经在多个工业部门得到应用。因此,开关磁阻电机在驱动调速领域有着良好的发展前景。本论文在对前人成果的广泛了解和研究基础上,以philip公司生产的LPC2101为主控芯片,充分利用其高速运算能力和面向电机控制的高效控制能力,设计并制作了SRM控制器与系统软件。本文以开关磁阻电机的调速控制策略及其控制实现方法为主要研究内容,对开关磁阻电机的数学模型、功率变换器技术、控制策略、控制方案的实现进行了全面深入的研究。 全文的研究工作分为五个部分,第一部分介绍了开关磁阻电机调速系统的构成及基本工作原理,综述了开关磁阻电机的国内外发展现状、特点及研究动向,总结了开关磁阻电机系统存在的技术问题,提出了本文的研究目的和主要研究内容。 第二部分引用并讨论了SR电动机的基本数学模型和准线性数学模型,然后基于此重点分析了与电动机运行特性密切相关的相电流波形与转子角位移的函数关系,最后根据课题所关心的控制系统设计,在理论分析的基础上提出了SR电动机控制方案并进行了原理性分析,对SR电动机各个运行阶段的特点进行分析并初步提出控制方案。 第三部分对SR电动机调速系统的硬件设计进行了详细说明,主要包括以LPC2101为核心的控制系统的研究与设计,根据SR电机的控制特点,尽可能地开发了LPC2101的硬件资源和软件资源,使控制系统具有很高的控制精度和灵活性,然后对功率变换器进行了设计和制作,分析了各种主电路形式的优缺点,采用了新型IGBT功率管作为主开关元器件,使功率变换器结构得到简化,设计了IGBT的功率驱动电路,并专门设计了电压钳位电路和诸如过压、过流保护等保护单元,保证了整个系统安全可靠地运行,然后分析了SR电动机控制系统位置传感器检测电路设计、电流及电压斩波电路设计、电流检测及保护电路设计等。 第四部分主要介绍了系统的总体控制思想,分析了各个运行阶段的控制策略,对控制策略的软件实现进行了设计,并给出了软件实现的具体流程图,直观地体现了软件编程思想。最后,对系统进行了实验研究及分析。目前,该控制系统已调试完毕,基本实现预期功能。 本文对以ARM为控制核心的开关磁阻电动机控制系统进行了研究,得出了基于有位置传感器检测的控制方案。针对SR电机的控制特点,充分利用了ARM的硬件资源,采用PID数字调节,发出相通断信号和PWM信号,并和电流、电压等保护信号相结合,实现对主功率元件的通断控制。并且设计了相应的外围硬件检测、保护、控制及人机接口电路,使控制系统结构紧凑,可靠性高;系统的控制软件设计,采用模块化的程序设计方法,增强了系统的可读性及可维护性,实现了一种电压斩波和电流斩波控制相结合的控制方式;结合系统的硬件设计,开发了相应的软件模块,使系统具有完善的保护和控制性能。 本系统经过试验,调速范围可达100~2000转/分,效率较高,性能优良,验证了控制思想和控制方法的正确性。

    标签: ARM 开关磁阻 电机驱动 系统设计

    上传时间: 2013-04-24

    上传用户:独孤求源

  • HDTV码流发生器内置信源解码板和基于FPGA的显示器测试信号发生器的研究

    该论文的工作主要分为两部分,第一部分是介绍与数字高清晰度电视(HDTV)码流发生器配套的信源解码板的设计与实现.信源解码板是整个码流发生器的重要组成部分,该论文在介绍相关标准MPEG-2和AC-3以及整个码流发生器功能的基础上提出了用ST公司的芯片组实现HDTV信源解码板的设计方案.论文详细分析了各个功能模块的具体设计方法以及实现时应注意的问题.目前该课题已经成功结题,各项技术指标完全符合合作单位的要求.该论文的第二部分主要是进行基于FPGA的显示器测试信号发生器的研究与开发.在对测试信号发生器所需产生的13种测试图案和所要适应的18种显示格式的介绍之后,该论文提出了以FLEX10K50为核心控制芯片的显示器测试信号发生器的设计方案.该论文详细讨论了FPGA设计中各个功能模块的划分和设计实现方法,并介绍了对FLEX10K50进行配置的方法.

    标签: HDTV FPGA 码流 发生器

    上传时间: 2013-04-24

    上传用户:yoleeson

  • 基于FPGA的MPEG4编解码芯片开发系统设计研究

    MPEG-4是目前非常流行的视频压缩标准,基于MPEG-4的视频处理系统有两种体系结构:可编程结构和专用结构.可编程结构灵活,适用范围广,易于升级,但电路复杂,电路功耗大.专用视频编解码器结构硬件开销小,处理速度高.该文主要研究专用的MPEG-4视频编解码芯片设计方法.目前市场上MPEG-4视频编解码芯片主要是Simple Profile级别的,而我们设计的芯片要实现Advanced Simple Profile级别.该文采用了一种基于大规模FPGA的软硬件相结的芯片设计方案,我们设计了基于FPGA的MPEG-4芯片设计开发平台,完成算法的硬件仿真与测试.论文围绕基于FPGA的MPEG-4芯片开发系统设计,分为两个部分.第一部分介绍了目前国内外实现MPEG-4视频处理系统的主要方法和应用,概述了国际上MPEG-4视频编解码芯片设计的一般方法及其发展趋势,详细描述了我们的基于FPGA的MPEG-4编解码芯片开发系统的结构.第二部分重点讲述了基于FPGA的MPEG-4芯片开发系统各个电路模块的设计,包括电源模块、FPGA配置模块、时钟生成模块、视频输入/输出模块、RS232串口模块、以太网接口模块、USB接口模块等.同时也介绍了I

    标签: MPEG4 FPGA 编解码芯片 开发系统

    上传时间: 2013-06-15

    上传用户:it男一枚

  • 基于FPGA的多路E1反向复用传输芯片的设计与实现

    随着电信数据传输对速率和带宽的要求变得越来越迫切,原有建成的网络是基于话音传输业务的网络,已不能适应当前的需求.而建设新的宽带网络需要相当大的投资且建设工期长,无法满足特定客户对高速数据传输的近期需求.反向复用技术是把一个单一的高速数据流在发送端拆散并放在两个或者多个低速数据链路上进行传输,在接收端再还原为高速数据流.该文提出一种基于FPGA的多路E1反向复用传输芯片的设计方案,使用四个E1构成高速数据的透明传输通道,支持E1线路间最大相对延迟64ms,通过链路容量调整机制,可以动态添加或删除某条E1链路,实现灵活、高效的利用现有网络实现视频、数据等高速数据的传输,能够节省带宽资源,降低成本,满足客户的需求.系统分为发送和接收两部分.发送电路实现四路E1的成帧操作,数据拆分采用线路循环与帧间插相结合的方法,A路插满一帧(30时隙)后,转入B路E1间插数据,依此类推,循环间插所有的数据.接收电路进行HDB3解码,帧同步定位(子帧同步和复帧同步),线路延迟判断,FIFO和SDRAM实现多路数据的对齐,最后按照约定的高速数据流的帧格式输出数据.整个数字电路采用Verilog硬件描述语言设计,通过前仿真和后仿真的验证.以30万门的FPGA器件作为硬件实现,经过综合和布线,特别是写约束和增量布线手动调整电路的布局,降低关键路径延时,最终满足设计要求.

    标签: FPGA 多路 传输 片的设计

    上传时间: 2013-07-16

    上传用户:asdkin