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教程资料 用CPLD设计实现一个具有预置数的数字钟
本设计要实现一个具有预置数的数字钟的设计,具体要求如下:\r\n1. 正确显示年、月、日 \r\n2. 正确显示时、分、秒 \r\n3. 具有校时,整点报时和秒表功能 \r\n4. 进行系统模拟仿真和下载编程实验,验证系统的正确性 \r\n
单片机编程 可预置可逆4位计数器
可预置可逆4位计数器
系统设计方案 可预置的8位计数器程序的主要部分分析 #include <AT89X51.H> //器件配置文件 #define uchar unsigned char //变量类型的宏定义
可预置的8位计数器程序的主要部分分析
#include <AT89X51.H> //器件配置文件
#define uchar unsigned char //变量类型的宏定义
#define uint unsigned int
uchar code SEG7[10]={0x03,0x9f,0x25,0x0d,0x99, //0~9的数码管段码
0x49,0x41,0x1f,0x01,0x09}
uchar data cnt[8] //在data区定义8位长度的数组，用来存 ...
单片机开发 可预置可逆4位计数器 利用AT89S51单片机的P1.0－P1.3接四个发光二极管L1－L4
可预置可逆4位计数器
利用AT89S51单片机的P1.0－P1.3接四个发光二极管L1－L4，用来指示当前计数的数据；用P1.4－P1.7作为预置数据的输入端，接四个拨动开关K1－K4，用P3.6/WR和P3.7/RD端口接两个轻触开关，用来作加计数和减计数开关 ...
其他嵌入式/单片机内容 计数器 同步异步预置数清零 verilog hdl 编写
计数器 同步异步预置数清零 verilog hdl 编写
VHDL/FPGA/Verilog 数字式移相信号发生器可以产生预置频率的正弦信号
数字式移相信号发生器可以产生预置频率的正弦信号，也可产生预置相位差的两路同频正弦信号，并能显示预置频率或相位差值；
文章/文档 我自己写的带有异步清零端的8位可预置移位寄存器
我自己写的带有异步清零端的8位可预置移位寄存器
单片机开发 可预置的8位计数器程序的主要部分分析
可预置的8位计数器程序的主要部分分析，用C语言开发！
VHDL/FPGA/Verilog 本设计要实现一个具有预置数的数字钟的设计,具体要求如下: 1. 正确显示年、月、日 2. 正确显示时、分、秒 3. 具有校时,整点报时和秒表功能 4. 进行系统模拟仿真和下载编程实验,验
本设计要实现一个具有预置数的数字钟的设计,具体要求如下:
1. 正确显示年、月、日
2. 正确显示时、分、秒
3. 具有校时,整点报时和秒表功能
4. 进行系统模拟仿真和下载编程实验,验证系统的正确性
系统设计方案 以 AT89S52为核心 ,通过 A/D、D/A转换和 V/ I转换及独特的算法实现高精度的电流控制 ,电流输出范围为 20～ 2000mA的数控直流电流源。该电流源具有电流可预置 , lmA步进
以 AT89S52为核心 ,通过 A/D、D/A转换和 V/ I转换及独特的算法实现高精度的电流控制 ,电流输出范围为 20～
2000mA的数控直流电流源。该电流源具有电流可预置 , lmA步进 ,同时显示给定值和实测值等功能。